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Por otra parte, en la medida de que la revista vaya descongestionándose por la presión de muchos artículos que se encuentran en proceso, volveremos a aceptar trabajos nuevos. En relación a los trabajos asociados a congresos y las editoriales, ellos siguen su proceso con normalidad.

Saludos cordiales,
Kristopher Chandia V.

Scimago

Volumen 16 N° 2, Julio - Septiembre 2008

pdf Índice

Descripción modular de un esquema de codificación concatenado para corrección de errores con programación de hardware

 

Cecilia E. Sandoval Ruiz                Antonio Fedón

 

1 Universidad de Carabobo/Dirección de Postgrado, Facultad de Ingeniería Naguanagua sector Bárbula Venezuela. Teléfonos directos (0241) 8672829 / 8674268 ext. 102,FAX: (0241) 8671655 Código postal: 2008. E-mail: csandoval1@uc.edu.ve , afedon@uc.edu.ve


 

RESUMEN

Las comunicaciones inalámbricas requieren el empleo de métodos de corrección de errores sobre los datos transmitidos, usándose generalmente técnicas de codificación  Reed-Solomon & Viterbi, por razones de desempeño y seguridad es preferible implementarlos sobre hardware. En este trabajo se presenta el diseño modular de la etapa de codificación de éstos códigos para su concatenación usando VHDL (VHSIC Hardware Descriptor Language), orientado a la implementación sobre tecnología de matriz de compuertas programadas por campo (FPGA), Se inicia con una revisión de los conceptos asociados a la definición de los componentes, y el modelo, descripción del comportamiento, luego la arquitectura es diseñada usando  la sintaxis en VHDL y es capturado el diseño de hardware, finalmente  se presentan los resultados de síntesis.

Palabras clave: VHDL, hardware reconfigurable, codificadores, comunicación digital.

 

ABSTRACT 

The wireless communication medium require employing forward error correction methods on the data transferred, where Reed-Solomon & Viterbi  coding techniques are utilized, because of performance and security reaso. In this paper we present a modular design of phase encoding these codes for concatenation using VHDL (VHSIC Hardware Descriptor Language) and oriented to implementation with field programmable gate arrays (FPGA). The work besing with a review of code concept and the definition of the components and the model and the description of the behavioral. Later, the architecture is designed and captures using syntax in VHDL, and finally presents the results of synthesis.

Keywords: VHDL, hardware re-configurable, coders, communication digital.

  

REFERENCIAS 

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